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KR102060552B1

Display device

Abstract

According to the present invention, the gradient of the electric field applied between the electrodes can be controlled by widening the distance between the electrodes for driving the liquid crystal, and an optimal electric field can be applied between the electrodes. A thin film transistor having a first electrode formed on a substrate, an insulating film formed on the substrate and on the first electrode, and a semiconductor film formed on the insulating film and having a source, a channel region, and a drain formed thereon, the thin film transistor being a layer above the semiconductor film, the first electrode A second electrode positioned above the first opening pattern, and a liquid crystal disposed above the second electrode.

KR102060552B1, drawing sheet 1
Sheet 1 of 39

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Expires 14 December 2038.

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  1. 1
    액정표시장치로서, 게이트 전극 및 게이트 절연막을 포함하고, 기판 위에 있는 보텀 게이트 트랜지스터;상기 기판 위에 있고 상기 기판과 접촉하는 공통 전극;상기 기판 위의 보조 배선;상기 보텀 게이트 트랜지스터의 n형 반도체막 위에 있고, 상기 보텀 게이트 트랜지스터의 상기 n형 반도체막과 접촉하는 제 1 도전막;상기 보텀 게이트 트랜지스터 및 상기 제 1 도전막 위의 제 1 절연막;상기 제 1 절연막 위에 있고 상기 제 1 절연막과 접촉하고, 상기 공통 전극과 중첩하는 개구 패턴들을 포함하는 화소 전극;상기 제 1 절연막 위에 있고, 상기 제 1 절연막과 접촉하는 제 2 도전막;상기 화소 전극 및 상기 제 2 도전막 위의 배향막;및 상기 배향막 위의 액정을 포함하고, 상기 보조 배선은 상기 공통 전극과 중첩하는 영역을 포함하고, 상기 제 2 도전막은 상기 제 1 절연막에 제공되고 상기 보조 배선과 중첩하는 제 1 접속구멍을 통해 상기 보조 배선의 상면과 접촉하는 영역을 포함하고, 상기 화소 전극은 상기 제 1 절연막에 제공되고 상기 보조 배선과 중첩하지 않는 제 2 접속구멍을 통해 상기 제 1 도전막의 상면과 접촉하는 영역을 포함하고, 상기 공통 전극은 상기 보텀 게이트 트랜지스터의 반도체막과 중첩하지 않는, 액정표시장치.
  2. 2
    액정표시장치로서, 기판 위의 게이트 전극;상기 기판 위에 있고 상기 기판과 접촉하는 공통 전극;상기 기판 위의 보조 배선;상기 게이트 전극 및 상기 보조 배선 위에 있고 상기 게이트 전극 및 상기 보조 배선과 접촉하는 게이트 절연막;상기 게이트 절연막 위에 있고 상기 게이트 절연막과 접촉하고, 상기 게이트 전극과 중첩하는 비정질 규소막;상기 비정질 규소막 위의 제 1 n형 반도체막;상기 비정질 규소막 위의 제 2 n형 반도체막;상기 제 1 n형 반도체막 위에 있고 상기 제 1 n형 반도체막과 접촉하는 소스 배선;상기 제 2 n형 반도체막 위에 있고 상기 제 2 n형 반도체막과 접촉하는 제 1 도전막;상기 소스 배선 및 상기 제 1 도전막 위의 제 1 절연막;상기 제 1 절연막 위에 있고 상기 제 1 절연막과 접촉하고, 상기 공통 전극과 중첩하는 개구 패턴들을 포함하는 화소 전극;상기 제 1 절연막 위에 있고 상기 제 1 절연막과 접촉하는 제 2 도전막;상기 화소 전극 및 상기 제 2 도전막 위의 배향막;및 상기 배향막 위의 액정을 포함하고, 상기 보조 배선은 상기 공통 전극과 중첩하는 영역을 포함하고, 상기 제 2 도전막은 상기 제 1 절연막에 제공되고 상기 보조 배선과 중첩하는 제 1 접속구멍을 통해 상기 보조 배선의 상면과 접촉하는 영역을 포함하고, 상기 화소 전극은 상기 제 1 절연막에 제공되고 상기 보조 배선과 중첩하지 않는 제 2 접속구멍을 통해 상기 제 1 도전막의 상면과 접촉하는 영역을 포함하고, 상기 공통 전극은 상기 비정질 규소막과 상기 소스 배선 중 어느 것과도 중첩하지 않는, 액정표시장치.
  3. 3
    제 2 항에 있어서, 상기 제 1 n형 반도체막과 상기 제 2 n형 반도체막은 각각 인 또는 비소가 도입되는 폴리실리콘 막인, 액정표시장치.
  4. 4
    제 1 항 또는 제 2 항에 있어서, 상기 제 1 도전막은 상기 게이트 절연막과 접촉하는 영역을 포함하는, 액정표시장치.
  5. 5
    제 1 항 또는 제 2 항에 있어서, 상기 공통 전극은 상기 제 1 도전막과 중첩하는, 액정표시장치.
  6. 6
    제 1 항 또는 제 2 항에 있어서, 상기 공통 전극 위의 제 2 절연막을 더 포함하고, 상기 게이트 전극과 상기 보조 배선은 상기 제 2 절연막 위에 위치하는, 액정표시장치.