Nova Patents
JPH08509826A

Compressed bios system.

Abstract

(57) [Summary] A means of supplying a BIOS routine from EPROM to RAM in a general purpose computer, where the BIOS routine is larger than the ERPOM line capacity in the number of lines of code. The BIOS routine is stored in three parts (11) in EPROM. The first part (13) is uncompressed, loadable, and powered by the computer's CPU to initialize the RAM. The second part (17) is compressed by one of several methods. The third part (15) is a compression / recovery utility that is loadable and is powered by the computer's CPU to restore the compressed part from the EPROM and copy the resulting code to RAM. The result is a BIOS in RAM.

JPH08509826A, drawing sheet 1
Sheet 1 of 4

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    【特許請求の範囲】 1.CPUマイクロプロセッサを有する汎用コンピュータのためのBIOSルー チンを供給する装置において、 プログラム可能な非揮発性メモリ装置と、 前記プログラム可能な非揮発性メモリ装置上に記憶されたBIOSルーチンと を具備し、 前記BIOSルーチンは、圧縮された部分と、前記汎用コンピュータにおいて 使用できるようにランダムアクセスメモリを準備するために前記CPUによって 動作される圧縮されない部分と、前記圧縮された部分を負荷し、それを圧縮から 復元し、圧縮から復元されたコードをランダムアクセスメモリにコピーするため に前記CPUによって動作される圧縮復元ユーティリティコードとを具備してい る装置。 2.前記プログラム可能な非揮発性メモリ装置は、EPROM、EEPROM、 フラッシュカードメモリ装置、マスクされたROM装置、バッテリを有するCM OSメモリ装置、および磁気バブルメモリ装置のいずれか1つである請求項1記 載の装置。 3.前記圧縮された部分は反復されたコードシーケンスを示すトークンコードを 有することによって圧縮され、前記反復されたコードシーケンスは前記トークン コードよりも長く、前記CPUによって同一であると証明される前記トークンコ ードは前記圧縮復元ユーティリティコードを動作して圧縮復元期間中前記トーク ンを前記反復されたコードシーケンスと取り替える請求項1記載の装置。 4.汎用コンピュータの動作を制御するためのCPUマイクロプロセッサと、 前記汎用コンピュータの動作において、動作可能なルーチンおよびデータを記 憶するためのランダムアクセスメモリ(RAM)と、 圧縮された部分と、圧縮されない部分と、圧縮復元ユーティリティを有するB IOSルーチンが記憶されるプログラム可能な非揮発性メモリ装置とを具備して いる汎用コンピュータにおいて、 前記圧縮されない部分は、前記RAMを使用できるように準備するために前記 CPUによって動作され、前記圧縮復元ユーティリティは、前記CPUによって 動作されて前記圧縮された部分を圧縮から復元し、結果として圧縮復元されたコ ードをRAMにコピーする汎用コンピュータ。 5.前記プログラム可能な読取り専用メモリ装置は、EPRM、EEPROM、 フラッシュカードメモリ装置、マスクされたROM装置、バッテリを有するCM OSメモリ装置、および磁気バブルメモリ装置のいずれか1つである請求項4記 載の汎用コンピュータ。 6.前記圧縮された部分は反復されたコードシーケンスを示すトークンコードを 有することによって圧縮され、前記反復されたコードシーケンスは前記トークン コードよりも長く、前記CPUによって同一であると証明される前記トークンコ ードは前記圧縮復元ユーティリティコードを動作して圧縮復元期間中前記トーク ンを前記反復されたコードシーケンスと 取り替える請求項4記載の汎用コンピュータ。 7.Nをnよりも大きい数として、n行の容量を有する非揮発性メモリ装置上に N行のコードを有しているBIOSルーチンを記憶する方法において、 オン・ボートRAMを使用できるように準備するためにCPUによって動作さ れる第1のコードシーケンスを、圧縮されない部分として記憶し、 圧縮されなかったときにBIOS機能を実行するようにCPUによって動作さ れる第2のコードシーケンスを圧縮された部分として記憶し、 前記第2のコードシーケンスを圧縮から復元し、結果として圧縮から復元され たコードをオン・ボードRAMにコピーするために前記CPUによって動作され る第3のコードシーケンスを圧縮復元ユーティリティとして記憶するBIOSル ーチンの記憶方法。 8.前記圧縮された部分は反復されたコードシーケンスを示すトークンコードを 有することによって圧縮され、前記反復されたコードシーケンスは前記トークン コードよりも長く、前記CPUによって同一であると証明される前記トークンコ ードは前記圧縮復元ユーティリティコードを動作して圧縮復元期間中前記トーク ンを前記反復されたコードシーケンスと取り替える請求項7記載の方法。 9.CPUマイクロプロセッサを有している汎用コンピュータにおけるRAMの 予め指定された部分においてRAMに存在するBIOSルーチンを始動時に与え る方法において、 RAMを初期化するための第1のコードシーケンスを非揮発性記憶装置からの CPUに負荷し、RAMを使用できるようにするために第1のコードシーケンス を動作し、 コードを圧縮から復元するための第2のコードシーケンスを非揮発性記憶装置 からCPUに負荷し、非揮発性記憶装置から第3の圧縮されたコードシーケンス を負荷するために第2のコードシーケンスを動作し、第3のコードシーケンスを 圧縮から復元し、結果として圧縮復元されたコードをRAMの前記予め指定され た部分にコピーするステップを具備している方法。 10.前記圧縮された部分は反復されたコードシーケンスを示すトークンコード を有することによって圧縮され、前記反復されたコードシーケンスは前記トーク ンコードよりも長く、前記CPUによって同一であると証明される前記トークン コードは前記圧縮復元ユーティリティコードを動作して圧縮復元期間中前記トー クンを前記反復されたコードシーケンスと取り替える請求項9記載の方法。 11.非揮発性メモリユニットからのコードの圧縮された部分を圧縮復元し、C PUを有する汎用コンピュータにおけるRAMの予め指定された位置において開 始する、結果として圧縮復元されたコードをコピーする方法において、 1行のコードの値がフラグ値と合致しないときにEPROMから前記RAMへ という順序で1回につき1行のコードをコピーし、 次の行を負荷し、前記1行のコードの値がフラグ値と合致 するときに前記次の行の値と表において関連した多数行のコードシーケンスをR AMにおける次の位置にコピーし、 RAMへそれぞれコピーした後に、最も新しく負荷されたコードの行が非揮発 性メモリユニットにおける最後の行かどうかを検査し、そうであった場合に、R AMにおける前記指定された位置に制御を向けるステップを具備している方法。